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将数字硬件与模仿模块整合到单个芯片中

2022-05-03 08:07:40 | 作者:bob球彩

  渠道的建立商,一般无法用上现成的一切部件。因其对体系提出了许多的要求,例如灵活性、密度、快速发布、以及可重新配置性。好音讯是,(Xilinx)于今日推出了其下一代 Zynq Ultrascale +

  射频SoC 是一种单芯片自适应无线nm 制程的加持下,Xilinx 将其硬件、可编程软件引擎、以及 RF 模仿技能,高密度地整合到了一同。在前几代产品中,体系需求依托多个芯片,来履行以下一切使命。但现在,Xilinx 供给了一套极端简化的方案规划,集成了彻底的 RF 信号链。

  从 MAC 到DSP、无线 IP、基带、调制、DSP 信令与滤波、ADCDAC、重头的通用数字处理器、以及 DDR4 内存子体系。Xilinx 表明,RFSoC 的优势之一,在于面向无线网络的 Massive-MIMO 射频模组。该公司介绍称,在 RFSoC 的协助下,64x64 m-MIMO 可将功耗下降一半、装置量削减75%、体系组件数量削减 89% 。

  第二代产品,是依据初代快速上市方案的快速战略调整,可掩盖 5GHz 频段,以便在中日等商场赶快投入运用。第三代产品归于改写后的规划,可掩盖 6GHz 频段,支撑已授权和空白频谱,旨在完结全球范围内的 5G 布置。不过首要走出大门的,仍是第二代产品。如上所述,它是面向亚洲商场的初代调理增强版,有望赶快打开 5G 频段下的测验。

  Xilinx 表明,现可向特定客户供给工程样品,并将于 2019 年 6 月全面投产。第三代产品选用了相似的底层硬件(四核 A53 + 带有可编程逻辑的双核 A5CPU)。不过还有固定功用的ADC / DAC 晋级,以及在不一起钟域上支撑 6GHz 频段、增强可编程逻辑的时钟,特别是关于具有高达 14 位处理的 6GHz 的额定 DSP 要求。

  Xilinx 表明,第三代产品将下降 TDD 上的功耗,扩展毫米波接口,以及完好的多频段 / 多规范支撑。增强型时钟还意味着在外部时钟发生器形式下,整个规划只需求一个外部时钟发生器,而不是之前所需的最多四个。Xilinx 表明,其集成的模仿 / 数字处理方案,还有助于毫米波扩展中频的施行。传统规划的一个问题是,射频采样离散 DSP 和数字前端之间的接口,是一个给定的规范(即 JESD204)。

  然而在 16x16 天线方案中,该规范接口在 320 Gb/s 时,功率耗费在 8W 左右。假如需求解析 800 MHz 的高频频谱,功耗就会大增。经过在第三代产品中整合数字、模仿组件,Xilinx 可在单芯片能完结悉数接口作业,然后带来更低的功耗、以及更高速的传输。

  该公司宣称,Xilinx 宣称,其答应一级供货商将它们的定制可编程 IP 与 RF 配套运用。二级供货商也可以运用专属的、或固定的 IP处理方案。经过该规划,Xilinx 可将 RF 商场添加到其产品组合中。据悉,第三代 RFSoC 将在 2019 下半年开端出样,并在 2020 年三季度开端量产。

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